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USDT交易所(www.usdt8.vip):《半导体》联电3角攻略 携手Cadence开发22奈米认证

来源:洛阳新闻网 发布时间:2021-07-14 浏览次数:

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联电(2303)今(13日)宣布Cadence优化的数位全流程已获得联电22奈米超低功耗(ULP)与22奈米超低泄电(ULL)制程手艺认证,以加速消费、5G和汽车应用设计。

该流程连系了用于超低功耗设计的领先设计实现和签核手艺,协助配合客户完成高品质的设计并实现更快的晶片设计定案(tapeout)流程。

Cadence数位全流程已针对联电的22ULP与ULL制程手艺举行优化,流程包罗Innovus设计实现系统、Genus合成解决方案、Liberate元件库特征化解决方案、Quantus寄生效应萃取解决方案、Tempus时序签核解决方案与物理验证系统(PVS和LPA)。

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联电示意,完全整合的引擎,可以让使用者能够实现功耗、效能和面积(PPA)目的并缩短上市时间。

联电矽智财研发暨设计支援四处长陈元辉示意,联电的22ULP与ULL平台异常适合种种半导体应用,包罗对功率或泄电敏感的消费类晶片,及需要更长电池寿命的可穿着产物。借由与Cadence互助,客户可使用联电最新的制程手艺和Cadence壮大的数位全流程,能够知足严酷的设计要求并实现设计和生产力目的。

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